本文作者：汪雨雯；叶凡；任俊彦；成功正常投稿发表论文到《复旦学报(自然科学版)》2014年03期,引用请注明来源400期刊网！

【摘要】：设计了一种适用于时间交织模数转换器的低抖动延迟锁定环,实现了12相时钟输出和6倍频输出功能.论文提出了一种基于信号通路切换的鉴频鉴相器,有效减小了工艺、电压、温度等对延迟锁定环性能的影响,优化了环路的抖动性能.延迟锁定环采用65nmCMOS工艺设计,芯片面积90μm×110μm,版图仿真验证其工作频率范围40~110MHz,电路整体功耗1.6mW,锁定时间小于1.2μs,均方根抖动为8.1ps,可满足模数转换器对时钟的要求.论文所采用的切换型鉴频鉴相器,相比于传统的鉴频鉴相器,其输出时钟的均方根抖动减小了19.3ps.
【论文正文预览】：模数转换器(Analog-DigitalConverter,ADC)是混合信号系统中必不可少的关键模块,其性能好坏直接影响到整个系统,时间交织ADC作为高速高精度ADC的一种实现方案被广泛应用,该方案使用多路ADC并行对输入信号进行转换,子ADC的采样时间均匀错开,系统在整体上等效为一个高速的模数
【文章分类号】：TN792
【稿件关键词】：时间交织模数转换器延迟锁定环鉴频鉴相器多相位时钟
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【稿件标题】：【adc模数转换器】一种应用于时间交织模数转换器的低抖动延迟锁定环
【作者单位】：复旦大学专用集成电路与系统国家重点实验室;
【发表期刊期数】：《复旦学报(自然科学版)》2014年03期
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【版权所有人】：汪雨雯；叶凡；任俊彦；

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